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국어문법론 핵심정리1. 형태소란 무엇이며, 그 기본형은 어떻게 표시하는가?문법 단위 중 가장 작은 단위를 형태소라 한다. 즉, 최소의 유의적 단위가 곧 형태소이다. 더 쪼개면 전혀 의미가 없어지는 문법 단위이다. 한 형태소에 여러 이형태가 있을 때 그 중 하나를 대표로 하여 정하여 기본형이라 부
14페이지 | 1,200원 | 2009.04.23
정리 ★ ① 수사(數詞) 수량이나 순서를 나타내는 품사를 ‘수사’라 한다. 문법상으로는 명사에 속한다. (1) 수(數)를 나타내는 것 : いち、に、ひしつ、ふたつ 등. (2) 수량(數量)을 나타내는 것 : 一枚(いちまい)、一時(いちじ) 등. (3) 순서(順序)를 나타내는 것 : 第一(だいいち)、一番(いちばん) 등
44페이지 | 1,700원 | 2005.10.14
스페인어 문법 정리1. 지시형용사와 지시대명사2. 소유형용사3. tener 동사4. 색깔 표현5. 신체 부위명6. ‘-ar’로 끝나는 동사7. ‘-er’로 끝나는 동사8. ir동사의 활용9. tener 동사의 활용10. 기수1. 지시형용사와 지시대명사ㆍ말하는 사람에게 가까울 때 → éste(이) 사용ㆍ듣는 사람에게 가까울 때
7페이지 | 1,800원 | 2022.12.15
스페인어 문법 정리자료1. 지시형용사와 지시대명사2. 소유형용사3. tener 동사4. 색깔 및 신체 부위명5. ‘-ar’로 끝나는 동사6. ‘-er’로 끝나는 동사7. ir동사의 활용8. tener 동사의 활용1. 지시형용사와 지시대명사말하는 사람에게 가까울 때 éste(이)가 사용되며 듣는 사람에게 가까울 때는 éso(그)
5페이지 | 1,800원 | 2022.12.15
스페인어 기본 문법 정리1. 지시형용사와 지시대명사, 소유 형용사2. tener 동사3. 색깔 및 신체 부위 표현4. ‘-ar’과 ‘-er’로 끝나는 동사5. ir동사와 tener동사6. 기수1. 지시형용사와 지시대명사, 소유 형용사ㆍ지시형용사, 지시대명사 → 가리키는 대상을 꾸미거나 나타내는 형용사와 명사ㆍ지시
7페이지 | 1,800원 | 2022.12.15
우리가 어려워하는 국어 문법 정리국어에는 5언 9품사가 있지만 사람들이 어려워하는 체언, 용언(용언의 활용), 수식언(관형사, 부사)에 대한 설명이다. 다른 부분들은 설명하지 않아도 익숙한 개념이기 때문에 넘어가려 한다.1.체언이라는 개념을 좀 더 쉽게 설명하자면, 문장에서 주인공이나 사물
3페이지 | 4,500원 | 2024.04.28
종합영어정리 문법편 - 名 詞 (Noun) Ⅰ1. 명사의 종류: 고유, 보통, 집합, 물질, 추상명사① 셀 수 있는 명사 : 단,복수 가능many, few로 수식. 보통, 집합명사.② 셀 수 없는 명사 : 단,복수 없음.much, little 이 수식. 물질, 고유, 추상명사.2. 종족 대표 : 어떤 종족의 전체.① A(an) + 단수보통명사.(대표단수)
108페이지 | 1,000원 | 2004.02.25
문법의 한 특성이다. 국어에서는 국민을 궁민으로 발음한다. ㄱ 소리는 콧소리 ㅁ이나 ㄴ앞에서 반드시 ㅇ으로 변하기 때문이다. 그러나 언어에 따라서는 이러한 변화가 전혀 허용되지 않는 경우도 있다.이러한 사실들을 체계적으로 정리하여 파악함으로써 국어에 대한 이해가 깊어지고 국
4페이지 | 600원 | 2004.07.05
시사영어-Populations are Aging Worldwide 해석 및 문법 정리
*Populations are Aging Worldwide*목 차01. 고령화 사회 배경02. 내용 정리 본 문 해 석관 련 어 휘문 법 정 리*어 휘 (Line 1 – 22)2; unprecedented 전례없는-unprecedentedly 부사형4; significant 중요한4; implications 결과,영향19; portion 부분*어 휘 (Line 1 – 22)25; on the rise 오름세에 있다27; segment 조각, 부분=part30; Bureau
26페이지 | 500원 | 2012.09.05
[Verilog, HDL, 논리] Verilog 문법 정리
verilog 문법 정리Verilog HDL의 개념Verilog HDL은 왜 필요한가?1다양한 아이디어를 하드웨어적으로 쉽게 표현할수 있다.2전체적인 시스템이 빠르게 구성되어 문제점 미리 파악 및 개선3디지털 회로 레벨까지 구체화 시킬수 있다.Verilog HDL의 개념Verilog의 Abstaction LevelBehavioralRTL-dataflowGate-structuralLayout
17페이지 | 1,500원 | 2009.08.31