[전자공학]알테라(Altera) 를 이용한 디지털 시계 구현
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- 2006.08.11 / 2019.12.24
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- 하고 싶은 말
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1. 실험목적
⇒ 디지털 시계 구현을 통해 디지털 시스템 설계 능력을 배양하자.
⇒ 규모가 있는 실제 응용회로 구현을 통해 simulation & verification의 중요성 이해.
2. 사용 부품 및 계측기
⇒ 알테라(Altera)
3. 이론적 내용 및 모의실험
① 카운터 설계
◎ MOD-3 카운터
왼쪽 그림은 MOD-3 카운터의 회로도이다.
카운터의 동작은 입력단자 A,B,C,D = LOW, DN = HIGH, CLR = LOW를 입력하고 UP입력단에 입력 클럭이 인가되면 출력값은 0000 ~ 1111 값이 출력되게 되는데 MOD-3 카운터를 설계하여야 되므로 0000, 0001, 0010의 출력값이 출력된 후 0011이 되었을때 1이 출력되는 값을 NAND GATE의 입력값으로 넣으면 그 출력값으로 0이 출력되게 된다. 이 출력값이 74193의 LOAD단자의 입력값으로 넣으면 입력 ABCD = 0 값이 LOAD되어 다시 0000 부터 카운터가 된다. 위의 그림에서 붉은 선은 클럭을 나타낸 것이고 회로에서 보면 출력단자에 OUTCK이 있는데 이 단자의 기능은 클럭이 3번 인가되어 다시 LOAD될때 그 캐리값을 다음 카운터의 클럭으로 넣어주기 위해 만들어 놓은것이다.
- 목차
-
1. 실험목적
2. 사용 부품 및 계측기
3. 이론적 내용 및 모의실험
②. 분주기 설계
③ 시계 및 시 조정 회로 설계시 조정회로알람회로 설계
⑤ STOP WATCH 설계 및 동작원리
⑥ 세그먼트표시기
⑧ WATCH, ALARM, STOP WATCH 모드변환 회로디지털 시계 전체 회로도
4.유의사항
- 본문내용
-
1. 실험목적
⇒ 디지털 시계 구현을 통해 디지털 시스템 설계 능력을 배양하자.
⇒ 규모가 있는 실제 응용회로 구현을 통해 simulation & verification의 중요성 이해.
2. 사용 부품 및 계측기
⇒ 알테라(Altera)
3. 이론적 내용 및 모의실험
① 카운터 설계
◎ MOD-3 카운터
왼쪽 그림은 MOD-3 카운터의 회로도이다.
카운터의 동작은 입력단자 A,B,C,D = LOW, DN = HIGH, CLR = LOW를 입력하고 UP입력단에 입력 클럭이 인가되면 출력값은 0000 ~ 1111 값이 출력되게 되는데 MOD-3 카운터를 설계하여야 되므로 0000, 0001, 0010의 출력값이 출력된 후 0011이 되었을때 1이 출력되는 값을 NAND GATE의 입력값으로 넣으면 그 출력값으로 0이 출력되게 된다. 이 출력값이 74193의 LOAD단자의 입력값으로 넣으면 입력 ABCD = 0 값이 LOAD되어 다시 0000 부터 카운터가 된다. 위의 그림에서 붉은 선은 클럭을 나타낸 것이고 회로에서 보면 출력단자에 OUTCK이 있는데 이 단자의 기능은 클럭이 3번 인가되어 다시 LOAD될때 그 캐리값을 다음 카운터의 클럭으로 넣어주기 위해 만들어 놓은것이다.
자료평가
- 기본적인 참고는 아주 잘 됩니다.
- joonun***
(2009.06.14 16:32:01)